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【2h】

Accurate estimation of total leakage current in scaled CMOS logic circuits based on compact current modeling

机译：基于紧凑电流建模精确估算缩放CmOs逻辑电路中的总漏电流

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作者
Saibal Mukhopadhyay; Arijit Raychowdhury; Kaushik Roy;
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年度 2013
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1. Accurate estimation of total leakage in nanometer-scale bulk CMOS circuits based on device geometry and doping profile [J] . Mukhopadhyay S., Raychowdhury A., Roy K. IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems . 2005,第3期

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2. Accurate Logic-Level Current Estimation for Digital CMOS Circuits [J] . P. Ruiz-de-Clavijo, J. Juan-Chico, M. J. Bellido, Journal of Low Power Electronics . 2006,第1期

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3. Accurate Logic-Level Current Estimation for Digital CMOS Circuits [J] . P. Ruiz-de-Clavijo, J. Juan-Chico, M. J. Bellido, Journal of Low Power Electronics . 2006,第1期

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4. Accurate estimation of total leakage current in scaled CMOS logic circuits based on compact current modeling [C] . Saibal Mukhopadhyay, Arijit Raychowdhury, Kaushik Roy Conference on Design automation . 2003

机译：基于紧凑型电流模型的CMOS逻辑电路中总漏电流的准确估计
5. Current and delay estimation in deep sub-micrometer CMOS logic circuits. [D] . Al-Mosawy, Muaayad. 2007

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6. Accurate dynamic power estimation for CMOS combinational logic circuits with real gate delay model [O] . Omnia S. Fadl, Mohamed F. Abu-Elyazeed, Mohamed B. Abdelhalim, 2016

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7. Modeling and estimation of total leakage current in nano-scaled CMOS devices considering the effect of parameter variation [O] . Saibal Mukhopadhyay, Kaushik Roy 2003

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